VHDL - conception pour cible FPGA
Orsys
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Présentiel
Public admis
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Entreprise
Etudiant
Prix
3348 €
Durée
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Localité
En présentiel
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Objectifs
À l'issue de la formation, le participant sera en mesure de :
Appréhender le langage VHDL et ses multiples possibilités
Connaître la syntaxe et les constructions essentielles utilisées pour le design FPGA
Produire du code VHDL de qualité conforme aux contraintes liées à la synthèse de FPGA
Simuler fonctionnellement un design en lui appliquant des stimuli via l'écriture d'un test bench simple
Appréhender le langage VHDL et ses multiples possibilités
Connaître la syntaxe et les constructions essentielles utilisées pour le design FPGA
Produire du code VHDL de qualité conforme aux contraintes liées à la synthèse de FPGA
Simuler fonctionnellement un design en lui appliquant des stimuli via l'écriture d'un test bench simple
Programme
Cette formation vous permettra d'acquérir des compétences générales dans la pratique du VHDL, langage destiné à représenter le comportement et l'architecture d'un système électronique numérique. Vous pourrez découvrir ce langage et développer votre premier projet VHDL.
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